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FPGA跨时钟域信号同步设计及分析方法研究

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摘要摘要随着FPGA功能越来越复杂，其内部设计经常包含多个异步时钟，将FPGA分割为多个时钟域。不同时钟域之间进行的数据和信号通信引入了跨时钟域问题。本文主要阐述了跨时钟域设计常见问题、跨时钟域信号同步方案，在此基础上从验证工程师的角度出发，介绍了如何进行跨时钟域验证的方法和步骤，为更好的进行跨时钟域分析提供了一种思路。

DOI rdxzxzl9jl/3365401

作者宋文强1胡毅2

机构地区（1.工业和信息化部电子第五研究所广州510610；2.重庆赛宝工业技术研究院重庆401332）

出处《电力设备》 2018年9期

关键词现场可编程逻辑器件跨时钟域亚稳态同步设计

分类 [电气工程][电力系统及自动化]

出版日期 2018年09月19日（中国期刊网平台首次上网日期，不代表论文的发表时间）